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OR回路の英語
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英訳・英語 logical add gate; OR gate; OR circuit
「OR回路」を含む例文一覧
該当件数 : 10件
an OR circuit [gate]発音を聞く 例文帳に追加
OR 回路[ゲート] - 研究社 英和コンピューター用語辞典
An OR circuit 221 operates logical sum of signals 111 to 113 and produces a signal 191.例文帳に追加
OR回路221は信号111乃至113の論理和を演算し、信号191を生成する。 - 特許庁
OR of output DLOUT after delay with the low frequency clock is taken by an OR circuit.例文帳に追加
遅延後の出力DLOUTはOR回路によって低周波クロックとの論理和が取られる。 - 特許庁
When the signal of the active state is inputted to an OR circuit 68, and the signal of the active state is outputted from the OR circuit 68, the switch 70 is turned off to cut a main power supply line 78.例文帳に追加
そのアクティブ状態の信号がOR回路68に入力され、OR回路68からアクティブ状態の信号が出力されると、スイッチ70がオフとなり、主電源ライン78が切断される。 - 特許庁
The logic sum of the access signal 22 and the access signal 24 is computed to generate a chip enable signal 26 in an OR circuit 12.例文帳に追加
OR回路12では、アクセス信号22とアクセス信号24の論理和を演算してチップイネーブル信号26を生成する。 - 特許庁
When the abnormality detection signal from the OR circuit 214 represents occurrence of abnormality, the CPU 15 provides an output of occurrence of abnormality to a lamp and a speaker of the pachinko machine or the like.例文帳に追加
CPU15は、OR回路214からの異常検知信号が、異常の発生を表している場合、パチンコ台のランプやスピーカなどに異常の発生を出力する。 - 特許庁
The power-on reset signal a and a power-on reset status clear signal e controllable by an internal register of an FPGA 5 are fed to an OR circuit 14.例文帳に追加
パワーオンリセット信号aと、FPGA5の内部レジスタにより制御可能なパワーオンリセットステータスクリア信号eがOR回路14に供給される。 - 特許庁
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Weblio英和対訳辞書での「OR回路」の英訳 |
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OR 回路
OR回路
「OR回路」を含む例文一覧
該当件数 : 10件
An on-off switching circuit of the discharge transistor 11 comprises an OR circuit 12 and a NOT circuit 4 to thereby invert a logical sum signal produced by summing an output voltage Ve and a control voltage Va of a current driver 10, and controls the on-off switching of the gate discharge transistor 2.例文帳に追加
放電トランジスタ断続回路11は、OR回路12とNOT回路4とにより構成され、電流ドライバ10の出力電圧Veと制御電圧Vaとの論理和信号を反転してゲート放電トランジスタ2を断続制御する。 - 特許庁
A circuit, which prohibits a BG3OUT* signal from becoming unstable and resulting in a LOW condition during configuration of the FPGA 16, is constructed of the power-on-reset circuit 11, a flip-flop 12, the power supply monitoring circuit 15, and an OR circuit 15.例文帳に追加
又、FPGA16のコンフィギュレーション中にBG3OUT* 信号が不定となりLOWになることを禁止する為の回路をパワーオンリセット回路11,フリップフロップ12,電源監視回路14,OR回路15にて構成する。 - 特許庁
An OR circuit 214 of an interface circuit 201 composes output signals from a power supply monitor circuit 81, an opening operation abnormality detection circuit 162, and a closing operation abnormality detection circuit 163 and provides an output of a composed output signal to a CPU 15 as an abnormality detection signal.例文帳に追加
インタフェイス回路201のOR回路214は、電源監視回路81、開放動作異常検知回路162、および閉塞動作異常検知回路163からの出力信号を合成し、異常検知信号としてCPU15に出力する。 - 特許庁
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